# Dépôts de alexforencich

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Les 13 dépôts GitHub publics de alexforencich, du plus étoilé au moins étoilé : étoiles, langage et rang de chaque carte RepoMasters.

## Dépôts de alexforencich

13 dépôts publics de alexforencich au catalogue, du plus étoilé au moins étoilé.

- [alexforencich/verilog-ethernet · ★ 3 143 · Verilog · RC](https://repo.masters-masters.com/repos/alexforencich/verilog-ethernet)
- [alexforencich/verilog-axi · ★ 2 168 · Verilog · RC](https://repo.masters-masters.com/repos/alexforencich/verilog-axi)
- [alexforencich/verilog-pcie · ★ 1 675 · Verilog · Bêta](https://repo.masters-masters.com/repos/alexforencich/verilog-pcie)
- [alexforencich/verilog-axis · ★ 923 · Python · Bêta](https://repo.masters-masters.com/repos/alexforencich/verilog-axis)
- [alexforencich/verilog-i2c · ★ 731 · Verilog · Bêta](https://repo.masters-masters.com/repos/alexforencich/verilog-i2c)
- [alexforencich/verilog-uart · ★ 591 · Verilog · Alpha](https://repo.masters-masters.com/repos/alexforencich/verilog-uart)
- [alexforencich/cocotbext-axi · ★ 368 · Python · Alpha](https://repo.masters-masters.com/repos/alexforencich/cocotbext-axi)
- [alexforencich/cocotbext-pcie · ★ 214 · Python · Prototype](https://repo.masters-masters.com/repos/alexforencich/cocotbext-pcie)
- [alexforencich/verilog-dsp · ★ 197 · Python · Prototype](https://repo.masters-masters.com/repos/alexforencich/verilog-dsp)
- [alexforencich/verilog-lfsr · ★ 165 · Python · Prototype](https://repo.masters-masters.com/repos/alexforencich/verilog-lfsr)
- [alexforencich/verilog-wishbone · ★ 137 · Python · Prototype](https://repo.masters-masters.com/repos/alexforencich/verilog-wishbone)
- [alexforencich/xboot · ★ 130 · C · Prototype](https://repo.masters-masters.com/repos/alexforencich/xboot)
- [alexforencich/verilog-cam · ★ 118 · Verilog · Prototype](https://repo.masters-masters.com/repos/alexforencich/verilog-cam)

## Voir alexforencich sur GitHub

- [https://github.com/alexforencich](https://github.com/alexforencich)

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Données : GitHub
