# AngeloJacobo/UberDDR3

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AngeloJacobo/UberDDR3, dépôt open source à 497 étoiles sur GitHub. Carte Alpha de RepoMasters. Opensource DDR3 Controller Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [AngeloJacobo](https://repo.masters-masters.com/owners/AngeloJacobo) |
| Étoiles | 497 |
| Forks | 82 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | GPL-3.0 |
| Création | 2023 |
| Sujets | controller, ddr3, phy, verilog, memory-controller, ddr3-controller, ddr3-phy, fpga |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [AngeloJacobo/UberDDR3](https://github.com/AngeloJacobo/UberDDR3) |

## Fiche du dépôt

Opensource DDR3 Controller

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de AngeloJacobo

- [AngeloJacobo/FPGA\_Book\_Experiments · ★ 203 · Verilog · Prototype](https://repo.masters-masters.com/repos/AngeloJacobo/FPGA_Book_Experiments)
- [AngeloJacobo/RISC-V · ★ 139 · Verilog · Prototype](https://repo.masters-masters.com/repos/AngeloJacobo/RISC-V)

## D’autres dépôts Verilog

- [vicharak-in/shrike · ★ 536 · Verilog · Alpha](https://repo.masters-masters.com/repos/vicharak-in/shrike)
- [danfoisy/vdatp · ★ 524 · Verilog · Alpha](https://repo.masters-masters.com/repos/danfoisy/vdatp)
- [MoonbaseOtago/vroom · ★ 523 · Verilog · Alpha](https://repo.masters-masters.com/repos/MoonbaseOtago/vroom)
- [hunterlew/convolution\_network\_on\_FPGA · ★ 488 · Verilog · Alpha](https://repo.masters-masters.com/repos/hunterlew/convolution_network_on_FPGA)
- [jhshi/openofdm · ★ 484 · Verilog · Alpha](https://repo.masters-masters.com/repos/jhshi/openofdm)
- [secworks/aes · ★ 471 · Verilog · Alpha](https://repo.masters-masters.com/repos/secworks/aes)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.