# EttusResearch/uhd

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EttusResearch/uhd, dépôt open source à 1 295 étoiles sur GitHub. Carte Bêta de RepoMasters. The USRP™ Hardware Driver Repository Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [EttusResearch](https://repo.masters-masters.com/owners/EttusResearch) |
| Étoiles | 1 295 |
| Forks | 792 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2013 |
| Sujets | uhd, usrp, sdr, driver, fpga |
| Rang | [Bêta (700 à 1 999 ★)](https://repo.masters-masters.com/ranks/box_office) |
| Voir sur GitHub | [EttusResearch/uhd](https://github.com/EttusResearch/uhd) |

## Fiche du dépôt

The USRP™ Hardware Driver Repository

Rang des dépôts qui ont 700 à 1 999 ★ sur GitHub. Probabilité publiée par carte tirée : 6 %. Rareté : Rare.

## Autres dépôts de EttusResearch

- [EttusResearch/fpga · ★ 315 · Verilog · Alpha](https://repo.masters-masters.com/repos/EttusResearch/fpga)
- [EttusResearch/gr-doa · ★ 144 · Python · Prototype](https://repo.masters-masters.com/repos/EttusResearch/gr-doa)

## D’autres dépôts Verilog

- [VerticalResearchGroup/miaow · ★ 1 431 · Verilog · Bêta](https://repo.masters-masters.com/repos/VerticalResearchGroup/miaow)
- [tiny-tpu-v2/tiny-tpu · ★ 1 413 · Verilog · Bêta](https://repo.masters-masters.com/repos/tiny-tpu-v2/tiny-tpu)
- [ultraembedded/biriscv · ★ 1 329 · Verilog · Bêta](https://repo.masters-masters.com/repos/ultraembedded/biriscv)
- [Digital-EDA/Digital-IDE · ★ 1 191 · Verilog · Bêta](https://repo.masters-masters.com/repos/Digital-EDA/Digital-IDE)
- [circuitvalley/USB\_C\_Industrial\_Camera\_FPGA\_USB3 · ★ 1 170 · Verilog · Bêta](https://repo.masters-masters.com/repos/circuitvalley/USB_C_Industrial_Camera_FPGA_USB3)
- [lnis-uofu/OpenFPGA · ★ 1 166 · Verilog · Bêta](https://repo.masters-masters.com/repos/lnis-uofu/OpenFPGA)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.