# Fraunhofer-IMS/airisc\_core\_complex

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Fraunhofer-IMS/airisc\_core\_complex, dépôt open source à 107 étoiles sur GitHub. Carte Prototype de RepoMasters. Fraunhofer IMS processor core. RISC-V ISA…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [Fraunhofer-IMS](https://repo.masters-masters.com/owners/Fraunhofer-IMS) |
| Étoiles | 107 |
| Forks | 20 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2021 |
| Sujets | risc-v, riscv, fpga, verilog, embedded-systems, ai, asic, smart-sensors, asil, functional-safety |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [Fraunhofer-IMS/airisc\_core\_complex](https://github.com/Fraunhofer-IMS/airisc_core_complex) |

## Fiche du dépôt

Fraunhofer IMS processor core. RISC-V ISA (RV32IM) with additional peripherals for embedded AI applications and smart sensors.

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de Fraunhofer-IMS

- [Fraunhofer-IMS/AIfES\_for\_Arduino · ★ 262 · C · Alpha](https://repo.masters-masters.com/repos/Fraunhofer-IMS/AIfES_for_Arduino)

## D’autres dépôts Verilog

- [bmartini/zynq-axis · ★ 107 · Verilog · Prototype](https://repo.masters-masters.com/repos/bmartini/zynq-axis)
- [ilaydayaman/CNN\_for\_SLR · ★ 107 · Verilog · Prototype](https://repo.masters-masters.com/repos/ilaydayaman/CNN_for_SLR)
- [ZipCPU/qspiflash · ★ 107 · Verilog · Prototype](https://repo.masters-masters.com/repos/ZipCPU/qspiflash)
- [cavnex/mc6809 · ★ 106 · Verilog · Prototype](https://repo.masters-masters.com/repos/cavnex/mc6809)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.