# KastnerRG/riffa

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KastnerRG/riffa, dépôt open source à 884 étoiles sur GitHub. Carte Bêta de RepoMasters. The RIFFA development repository Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [KastnerRG](https://repo.masters-masters.com/owners/KastnerRG) |
| Étoiles | 884 |
| Forks | 343 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2015 |
| Rang | [Bêta (700 à 1 999 ★)](https://repo.masters-masters.com/ranks/box_office) |
| Voir sur GitHub | [KastnerRG/riffa](https://github.com/KastnerRG/riffa) |

## Fiche du dépôt

The RIFFA development repository

Rang des dépôts qui ont 700 à 1 999 ★ sur GitHub. Probabilité publiée par carte tirée : 6 %. Rareté : Rare.

## Autres dépôts de KastnerRG

- [KastnerRG/pp4fpgas · ★ 915 · TeX · Bêta](https://repo.masters-masters.com/repos/KastnerRG/pp4fpgas)
- [KastnerRG/cgra4ml · ★ 129 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/KastnerRG/cgra4ml)

## D’autres dépôts Verilog

- [open-sdr/openwifi-hw · ★ 916 · Verilog · Bêta](https://repo.masters-masters.com/repos/open-sdr/openwifi-hw)
- [FeSens/openTPU · ★ 898 · Verilog · Bêta](https://repo.masters-masters.com/repos/FeSens/openTPU)
- [lvyufeng/step\_into\_mips · ★ 886 · Verilog · Bêta](https://repo.masters-masters.com/repos/lvyufeng/step_into_mips)
- [Obijuan/open-fpga-verilog-tutorial · ★ 871 · Verilog · Bêta](https://repo.masters-masters.com/repos/Obijuan/open-fpga-verilog-tutorial)
- [xiaop1/Verilog-Practice · ★ 818 · Verilog · Bêta](https://repo.masters-masters.com/repos/xiaop1/Verilog-Practice)
- [rejunity/z80-open-silicon · ★ 814 · Verilog · Bêta](https://repo.masters-masters.com/repos/rejunity/z80-open-silicon)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.