# MPSU/APS

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MPSU/APS, dépôt open source à 362 étoiles sur GitHub. Carte Alpha de RepoMasters. Laboratory course on RISC-V Processor Development Langage : SystemVerilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [MPSU](https://repo.masters-masters.com/owners/MPSU) |
| Étoiles | 362 |
| Forks | 89 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | CC-BY-SA-4.0 |
| Création | 2023 |
| Sujets | fpga, riscv, systemverilog, risc-v, rv32i, study |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [MPSU/APS](https://github.com/MPSU/APS) |

## Fiche du dépôt

Laboratory course on RISC-V Processor Development

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de MPSU

- [MPSU/exAPS · ★ 101 · Prototype](https://repo.masters-masters.com/repos/MPSU/exAPS)

## D’autres dépôts SystemVerilog

- [chipsalliance/sv-tests · ★ 406 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/chipsalliance/sv-tests)
- [facebookresearch/deepfloat · ★ 401 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/facebookresearch/deepfloat)
- [pulp-platform/FlooNoC · ★ 371 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/pulp-platform/FlooNoC)
- [chipsalliance/Cores-VeeR-EL2 · ★ 349 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/chipsalliance/Cores-VeeR-EL2)
- [RHSResearchLLC/NiteFury-and-LiteFury · ★ 337 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/RHSResearchLLC/NiteFury-and-LiteFury)
- [pulp-platform/riscv-dbg · ★ 332 · SystemVerilog · Alpha](https://repo.masters-masters.com/repos/pulp-platform/riscv-dbg)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.