# PyHDI/Pyverilog

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PyHDI/Pyverilog, dépôt open source à 802 étoiles sur GitHub. Carte Bêta de RepoMasters. Python-based Hardware Design Processing Toolkit for Verilog HDL

| Champ | Valeur |
| --- | --- |
| Propriétaire | [PyHDI](https://repo.masters-masters.com/owners/PyHDI) |
| Étoiles | 802 |
| Forks | 213 |
| Langage | [Python](https://repo.masters-masters.com/languages/python) |
| Licence | Apache-2.0 |
| Création | 2013 |
| Sujets | verilog-hdl, hardware, compiler, parser, dataflow-analyzer, control-flow-analyzer, code-generator, python |
| Rang | [Bêta (700 à 1 999 ★)](https://repo.masters-masters.com/ranks/box_office) |
| Voir sur GitHub | [PyHDI/Pyverilog](https://github.com/PyHDI/Pyverilog) |

## Fiche du dépôt

Python-based Hardware Design Processing Toolkit for Verilog HDL

Rang des dépôts qui ont 700 à 1 999 ★ sur GitHub. Probabilité publiée par carte tirée : 6 %. Rareté : Rare.

## Autres dépôts de PyHDI

- [PyHDI/veriloggen · ★ 326 · Python · Alpha](https://repo.masters-masters.com/repos/PyHDI/veriloggen)

## D’autres dépôts Python

- [lonr-6/cc-desktop-switch · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/lonr-6/cc-desktop-switch)
- [litaolemo/xtquant\_big\_convert · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/litaolemo/xtquant_big_convert)
- [thruwire/foreman · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/thruwire/foreman)
- [yusuketomoto/chainer-fast-neuralstyle · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/yusuketomoto/chainer-fast-neuralstyle)
- [jingweiz/pytorch-rl · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/jingweiz/pytorch-rl)
- [JetBrains/projector-installer · ★ 802 · Python · Bêta](https://repo.masters-masters.com/repos/JetBrains/projector-installer)

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Données : GitHub · Illustration : image publique du projet, pixelisée par RepoMasters.