# RC4ML/Shuhai

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RC4ML/Shuhai, dépôt open source à 123 étoiles sur GitHub. Carte Prototype de RepoMasters. Shuhai is a benchmarking-memory tool that allows FPGA programmers to…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [RC4ML](https://repo.masters-masters.com/owners/RC4ML) |
| Étoiles | 123 |
| Forks | 24 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | Aucune |
| Création | 2020 |
| Sujets | benchmark, ddr, fpga, hbm |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [RC4ML/Shuhai](https://github.com/RC4ML/Shuhai) |

## Fiche du dépôt

Shuhai is a benchmarking-memory tool that allows FPGA programmers to demystify all the underlying details of memories, e.g., HBM and DDR4, on a Xilinx FPGA \[FCCM 20\]

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de RC4ML

- [RC4ML/FpgaNIC · ★ 148 · TeX · Prototype](https://repo.masters-masters.com/repos/RC4ML/FpgaNIC)

## D’autres dépôts SystemVerilog

- [openhwfoundation/cv-hpdcache · ★ 124 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/openhwfoundation/cv-hpdcache)
- [meiniKi/FazyRV · ★ 124 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/meiniKi/FazyRV)
- [pulp-platform/pulp\_cluster · ★ 123 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/pulp-platform/pulp_cluster)
- [zero-day-labs/riscv-iommu · ★ 122 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/zero-day-labs/riscv-iommu)
- [daglem/reDIP-SID · ★ 121 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/daglem/reDIP-SID)
- [Siddhi-95/AHB-to-APB-Bridge-Verification · ★ 121 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/Siddhi-95/AHB-to-APB-Bridge-Verification)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.