# Weiyet/MakerCode\_RTLChallenge

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Weiyet/MakerCode\_RTLChallenge, dépôt open source à 109 étoiles sur GitHub. Carte Prototype de RepoMasters. Public RTL Question Bank of MakerCode…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [Weiyet](https://repo.masters-masters.com/owners/Weiyet) |
| Étoiles | 109 |
| Forks | 27 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | MIT |
| Création | 2026 |
| Sujets | asic-design, fpga, programming, puzzle, rtl-design |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [Weiyet/MakerCode\_RTLChallenge](https://github.com/Weiyet/MakerCode_RTLChallenge) |

## Fiche du dépôt

Public RTL Question Bank of MakerCode https://makercode.jixiao-ai.com/

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts SystemVerilog

- [trivialmips/TrivialMIPS · ★ 110 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/trivialmips/TrivialMIPS)
- [eliaskousk/parallella-riscv · ★ 109 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/eliaskousk/parallella-riscv)
- [mmxsrup/axi4-interface · ★ 109 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/mmxsrup/axi4-interface)
- [spcl/pspin · ★ 108 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/spcl/pspin)
- [WangXuan95/UH-JLS · ★ 108 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/WangXuan95/UH-JLS)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.