# ZFTurbo/MobileNet-in-FPGA

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ZFTurbo/MobileNet-in-FPGA, dépôt open source à 191 étoiles sur GitHub. Carte Prototype de RepoMasters. Generator of verilog description for FPGA MobileNet…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [ZFTurbo](https://repo.masters-masters.com/owners/ZFTurbo) |
| Étoiles | 191 |
| Forks | 35 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2019 |
| Sujets | fpga, fpga-mobilenet, verilog |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [ZFTurbo/MobileNet-in-FPGA](https://github.com/ZFTurbo/MobileNet-in-FPGA) |

## Fiche du dépôt

Generator of verilog description for FPGA MobileNet implementation

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de ZFTurbo

- [ZFTurbo/Weighted-Boxes-Fusion · ★ 1 832 · Python · Bêta](https://repo.masters-masters.com/repos/ZFTurbo/Weighted-Boxes-Fusion)
- [ZFTurbo/Music-Source-Separation-Training · ★ 1 623 · Python · Bêta](https://repo.masters-masters.com/repos/ZFTurbo/Music-Source-Separation-Training)
- [ZFTurbo/MVSEP-MDX23-music-separation-model · ★ 865 · Python · Bêta](https://repo.masters-masters.com/repos/ZFTurbo/MVSEP-MDX23-music-separation-model)
- [ZFTurbo/Verilog-Generator-of-Neural-Net-Digit-Detector-for-FPGA · ★ 314 · Verilog · Alpha](https://repo.masters-masters.com/repos/ZFTurbo/Verilog-Generator-of-Neural-Net-Digit-Detector-for-FPGA)
- [ZFTurbo/Keras-RetinaNet-for-Open-Images-Challenge-2018 · ★ 269 · Python · Alpha](https://repo.masters-masters.com/repos/ZFTurbo/Keras-RetinaNet-for-Open-Images-Challenge-2018)
- [ZFTurbo/volumentations · ★ 260 · Python · Alpha](https://repo.masters-masters.com/repos/ZFTurbo/volumentations)

## D’autres dépôts Verilog

- [FPGADude/Digital-Design · ★ 193 · Verilog · Prototype](https://repo.masters-masters.com/repos/FPGADude/Digital-Design)
- [bluespec/Toooba · ★ 192 · Verilog · Prototype](https://repo.masters-masters.com/repos/bluespec/Toooba)
- [MiSTer-devel/Minimig-AGA\_MiSTer · ★ 191 · Verilog · Prototype](https://repo.masters-masters.com/repos/MiSTer-devel/Minimig-AGA_MiSTer)
- [FPGAwars/FPGA-peripherals · ★ 189 · Verilog · Prototype](https://repo.masters-masters.com/repos/FPGAwars/FPGA-peripherals)
- [mtmd/FPGA\_Based\_CNN · ★ 187 · Verilog · Prototype](https://repo.masters-masters.com/repos/mtmd/FPGA_Based_CNN)
- [flytt-away/FPGA-Video-Capture · ★ 187 · Verilog · Prototype](https://repo.masters-masters.com/repos/flytt-away/FPGA-Video-Capture)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.