# adamgallas/llama-fpga

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adamgallas/llama-fpga, dépôt open source à 223 étoiles sur GitHub. Carte Prototype de RepoMasters. \[DATE'25, ICCAD'25\] An embedded FPGA-based LLM accelerator…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [adamgallas](https://repo.masters-masters.com/owners/adamgallas) |
| Étoiles | 223 |
| Forks | 39 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2025 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [adamgallas/llama-fpga](https://github.com/adamgallas/llama-fpga) |

## Fiche du dépôt

\[DATE'25, ICCAD'25\] An embedded FPGA-based LLM accelerator capable of supporting Llama2-7B

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de adamgallas

- [adamgallas/fpga\_accelerator\_yolov3tiny · ★ 297 · VHDL · Alpha](https://repo.masters-masters.com/repos/adamgallas/fpga_accelerator_yolov3tiny)

## D’autres dépôts Verilog

- [WangXuan95/FPGA-DDR-SDRAM · ★ 224 · Verilog · Prototype](https://repo.masters-masters.com/repos/WangXuan95/FPGA-DDR-SDRAM)
- [emu-russia/breaks · ★ 223 · Verilog · Prototype](https://repo.masters-masters.com/repos/emu-russia/breaks)
- [YosysHQ/riscv-formal · ★ 223 · Verilog · Prototype](https://repo.masters-masters.com/repos/YosysHQ/riscv-formal)
- [wuxx/icesugar-pro · ★ 222 · Verilog · Prototype](https://repo.masters-masters.com/repos/wuxx/icesugar-pro)
- [ShawnHymel/introduction-to-fpga · ★ 219 · Verilog · Prototype](https://repo.masters-masters.com/repos/ShawnHymel/introduction-to-fpga)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.