# ataradov/riscv

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ataradov/riscv, dépôt open source à 155 étoiles sur GitHub. Carte Prototype de RepoMasters. Verilog implementation of a RISC-V core Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [ataradov](https://repo.masters-masters.com/owners/ataradov) |
| Étoiles | 155 |
| Forks | 21 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | BSD-3-Clause |
| Création | 2018 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [ataradov/riscv](https://github.com/ataradov/riscv) |

## Fiche du dépôt

Verilog implementation of a RISC-V core

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de ataradov

- [ataradov/usb-sniffer · ★ 1 295 · C · Bêta](https://repo.masters-masters.com/repos/ataradov/usb-sniffer)
- [ataradov/usb-sniffer-lite · ★ 705 · C · Bêta](https://repo.masters-masters.com/repos/ataradov/usb-sniffer-lite)
- [ataradov/free-dap · ★ 347 · C · Alpha](https://repo.masters-masters.com/repos/ataradov/free-dap)
- [ataradov/mcu-starter-projects · ★ 343 · C · Alpha](https://repo.masters-masters.com/repos/ataradov/mcu-starter-projects)
- [ataradov/edbg · ★ 323 · C · Alpha](https://repo.masters-masters.com/repos/ataradov/edbg)
- [ataradov/open-5012h · ★ 148 · C · Prototype](https://repo.masters-masters.com/repos/ataradov/open-5012h)

## D’autres dépôts Verilog

- [m-labs/milkymist · ★ 155 · Verilog · Prototype](https://repo.masters-masters.com/repos/m-labs/milkymist)
- [ejrh/cpu · ★ 155 · Verilog · Prototype](https://repo.masters-masters.com/repos/ejrh/cpu)
- [lnis-uofu/SOFA · ★ 155 · Verilog · Prototype](https://repo.masters-masters.com/repos/lnis-uofu/SOFA)
- [danshanley/FPU · ★ 154 · Verilog · Prototype](https://repo.masters-masters.com/repos/danshanley/FPU)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.