# bxinquan/zynq\_cam\_isp\_demo

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bxinquan/zynq\_cam\_isp\_demo, dépôt open source à 345 étoiles sur GitHub. Carte Alpha de RepoMasters. 基于verilog实现了ISP图像处理IP Langage : VHDL.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [bxinquan](https://repo.masters-masters.com/owners/bxinquan) |
| Étoiles | 345 |
| Forks | 110 |
| Langage | [VHDL](https://repo.masters-masters.com/languages/vhdl) |
| Licence | MIT |
| Création | 2022 |
| Sujets | isp, image-signal-processor |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [bxinquan/zynq\_cam\_isp\_demo](https://github.com/bxinquan/zynq_cam_isp_demo) |

## Fiche du dépôt

基于verilog实现了ISP图像处理IP

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de bxinquan

- [bxinquan/zynqmp\_cam\_isp\_demo · ★ 127 · VHDL · Prototype](https://repo.masters-masters.com/repos/bxinquan/zynqmp_cam_isp_demo)

## D’autres dépôts VHDL

- [howerj/forth-cpu · ★ 379 · VHDL · Alpha](https://repo.masters-masters.com/repos/howerj/forth-cpu)
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- [Ttl/fmcw3 · ★ 323 · VHDL · Alpha](https://repo.masters-masters.com/repos/Ttl/fmcw3)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.