# chipsalliance/chisel

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chipsalliance/chisel, dépôt open source à 4 826 étoiles sur GitHub. Carte RC de RepoMasters. Chisel: A Modern Hardware Design Language Langage : Scala.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [chipsalliance](https://repo.masters-masters.com/owners/chipsalliance) |
| Étoiles | 4 826 |
| Forks | 665 |
| Langage | [Scala](https://repo.masters-masters.com/languages/scala) |
| Licence | Apache-2.0 |
| Création | 2015 |
| Sujets | chisel, chisel3, scala, firrtl, rtl, chip-generator, verilog |
| Rang | [RC (2 000 à 4 999 ★)](https://repo.masters-masters.com/ranks/blockbuster) |
| Voir sur GitHub | [chipsalliance/chisel](https://github.com/chipsalliance/chisel) |

## Fiche du dépôt

Chisel: A Modern Hardware Design Language

Rang des dépôts qui ont 2 000 à 4 999 ★ sur GitHub. Probabilité publiée par carte tirée : 3 %. Rareté : Épique.

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- [chipsalliance/Cores-VeeR-EH1 · ★ 971 · SystemVerilog · Bêta](https://repo.masters-masters.com/repos/chipsalliance/Cores-VeeR-EH1)
- [chipsalliance/firrtl · ★ 748 · Scala · Bêta](https://repo.masters-masters.com/repos/chipsalliance/firrtl)
- [chipsalliance/chisel-template · ★ 710 · Shell · Bêta](https://repo.masters-masters.com/repos/chipsalliance/chisel-template)

## D’autres dépôts Scala

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Données : GitHub · Illustration : image publique du projet, pixelisée par RepoMasters.