# courageheart/AMBA\_APB\_SRAM

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courageheart/AMBA\_APB\_SRAM, dépôt open source à 202 étoiles sur GitHub. Carte Prototype de RepoMasters. AMBA v.3 APB v.1 Specification Complaint Slave SRAM…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [courageheart](https://repo.masters-masters.com/owners/courageheart) |
| Étoiles | 202 |
| Forks | 75 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | MIT |
| Création | 2019 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [courageheart/AMBA\_APB\_SRAM](https://github.com/courageheart/AMBA_APB_SRAM) |

## Fiche du dépôt

AMBA v.3 APB v.1 Specification Complaint Slave SRAM Core design and testbench. The testbench is developed using System Verilog and UVM and can be used as standalone Verification IP (VIP).

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts SystemVerilog

- [eevaain/tiny-tpu-old · ★ 206 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/eevaain/tiny-tpu-old)
- [MiSTer-devel/NES\_MiSTer · ★ 205 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/MiSTer-devel/NES_MiSTer)
- [FeSens/auto-arch-tournament · ★ 205 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/FeSens/auto-arch-tournament)
- [aignacio/ravenoc · ★ 201 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/aignacio/ravenoc)
- [yuri-panchul/systemverilog-homework · ★ 199 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/yuri-panchul/systemverilog-homework)
- [tscheipel/HaDes-V · ★ 198 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/tscheipel/HaDes-V)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.