# ekb0412/100DaysofRTL

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ekb0412/100DaysofRTL, dépôt open source à 134 étoiles sur GitHub. Carte Prototype de RepoMasters. "100 days of RTL" is a personal project to learn Verilog HDL…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [ekb0412](https://repo.masters-masters.com/owners/ekb0412) |
| Étoiles | 134 |
| Forks | 17 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Apache-2.0 |
| Création | 2023 |
| Sujets | digital-system-design, asic, fpga, xilinx-vivado, verilog-hdl, vlsi-design |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [ekb0412/100DaysofRTL](https://github.com/ekb0412/100DaysofRTL) |

## Fiche du dépôt

"100 days of RTL" is a personal project to learn Verilog HDL RTL design in 100 days, using Xilinx Vivado

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts Verilog

- [airin711/Verilog-caches · ★ 134 · Verilog · Prototype](https://repo.masters-masters.com/repos/airin711/Verilog-caches)
- [Daniel-GGB/My-Digital-IC-Library · ★ 134 · Verilog · Prototype](https://repo.masters-masters.com/repos/Daniel-GGB/My-Digital-IC-Library)
- [AugustinJose1221/FPGA-Build · ★ 134 · Verilog · Prototype](https://repo.masters-masters.com/repos/AugustinJose1221/FPGA-Build)
- [robinhedwards/UltimateCart · ★ 133 · Verilog · Prototype](https://repo.masters-masters.com/repos/robinhedwards/UltimateCart)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.