# eugene-tarassov/vivado-risc-v

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eugene-tarassov/vivado-risc-v, dépôt open source à 1 103 étoiles sur GitHub. Carte Bêta de RepoMasters. Xilinx Vivado block designs for FPGA RISC-V SoC…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [eugene-tarassov](https://repo.masters-masters.com/owners/eugene-tarassov) |
| Étoiles | 1 103 |
| Forks | 256 |
| Langage | [Tcl](https://repo.masters-masters.com/languages/tcl) |
| Licence | Aucune |
| Création | 2020 |
| Sujets | nexys-video, risc-v, linux, xilinx, vivado, fpga, vc707, genesys2, boom, rocketchip |
| Rang | [Bêta (700 à 1 999 ★)](https://repo.masters-masters.com/ranks/box_office) |
| Voir sur GitHub | [eugene-tarassov/vivado-risc-v](https://github.com/eugene-tarassov/vivado-risc-v) |

## Fiche du dépôt

Xilinx Vivado block designs for FPGA RISC-V SoC running Debian Linux distro

Rang des dépôts qui ont 700 à 1 999 ★ sur GitHub. Probabilité publiée par carte tirée : 6 %. Rareté : Rare.

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.