# hell03end/verilog-uart

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hell03end/verilog-uart, dépôt open source à 121 étoiles sur GitHub. Carte Prototype de RepoMasters. Simple 8-bit UART realization on Verilog HDL.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [hell03end](https://repo.masters-masters.com/owners/hell03end) |
| Étoiles | 121 |
| Forks | 21 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | MIT |
| Création | 2018 |
| Sujets | verilog, hdl, quartus, uart, fpga |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [hell03end/verilog-uart](https://github.com/hell03end/verilog-uart) |

## Fiche du dépôt

Simple 8-bit UART realization on Verilog HDL.

Archivé : ce dépôt n’évolue plus

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts Verilog

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.