# iammituraj/pequeno\_riscv

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iammituraj/pequeno\_riscv, dépôt open source à 161 étoiles sur GitHub. Carte Prototype de RepoMasters. Pequeno R5 (PQR5) is a 5-stage pipelined in-order RISC-V…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [iammituraj](https://repo.masters-masters.com/owners/iammituraj) |
| Étoiles | 161 |
| Forks | 15 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | Apache-2.0 |
| Création | 2023 |
| Sujets | cpu, risc-v, rtl, fpga, systemverilog |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [iammituraj/pequeno\_riscv](https://github.com/iammituraj/pequeno_riscv) |

## Fiche du dépôt

Pequeno R5 (PQR5) is a 5-stage pipelined in-order RISC-V CPU Core compliant with RV32IM ISA.

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts SystemVerilog

- [GodelMachine/AHB2 · ★ 164 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/GodelMachine/AHB2)
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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.