# icebreaker-fpga/icebreaker-verilog-examples

<https://repo.masters-masters.com/repos/icebreaker-fpga/icebreaker-verilog-examples>

[Accueil](https://repo.masters-masters.com/) › [icebreaker-fpga](https://repo.masters-masters.com/owners/icebreaker-fpga) › [icebreaker-verilog-examples](https://repo.masters-masters.com/repos/icebreaker-fpga/icebreaker-verilog-examples)

icebreaker-fpga/icebreaker-verilog-examples, dépôt open source à 162 étoiles sur GitHub. Carte Prototype de RepoMasters. This repository contains small…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [icebreaker-fpga](https://repo.masters-masters.com/owners/icebreaker-fpga) |
| Étoiles | 162 |
| Forks | 40 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2018 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [icebreaker-fpga/icebreaker-verilog-examples](https://github.com/icebreaker-fpga/icebreaker-verilog-examples) |

## Fiche du dépôt

This repository contains small example designs that can be used with the open source icestorm flow.

Archivé : ce dépôt n’évolue plus

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de icebreaker-fpga

- [icebreaker-fpga/icebreaker · ★ 678 · Alpha](https://repo.masters-masters.com/repos/icebreaker-fpga/icebreaker)
- [icebreaker-fpga/icebreaker-workshop · ★ 145 · Verilog · Prototype](https://repo.masters-masters.com/repos/icebreaker-fpga/icebreaker-workshop)

## D’autres dépôts Verilog

- [ConstStrings/GoWinSDR · ★ 164 · Verilog · Prototype](https://repo.masters-masters.com/repos/ConstStrings/GoWinSDR)
- [leo47007/TPU-Tensor-Processing-Unit · ★ 162 · Verilog · Prototype](https://repo.masters-masters.com/repos/leo47007/TPU-Tensor-Processing-Unit)
- [WangXuan95/FPGA-Gzip-compressor · ★ 162 · Verilog · Prototype](https://repo.masters-masters.com/repos/WangXuan95/FPGA-Gzip-compressor)
- [TimRudy/ice-chips-verilog · ★ 160 · Verilog · Prototype](https://repo.masters-masters.com/repos/TimRudy/ice-chips-verilog)
- [zslwyuan/Basic-SIMD-Processor-Verilog-Tutorial · ★ 160 · Verilog · Prototype](https://repo.masters-masters.com/repos/zslwyuan/Basic-SIMD-Processor-Verilog-Tutorial)

---
Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.