# jakubcabal/uart-for-fpga

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jakubcabal/uart-for-fpga, dépôt open source à 111 étoiles sur GitHub. Carte Prototype de RepoMasters. Simple UART controller for FPGA written in VHDL

| Champ | Valeur |
| --- | --- |
| Propriétaire | [jakubcabal](https://repo.masters-masters.com/owners/jakubcabal) |
| Étoiles | 111 |
| Forks | 31 |
| Langage | [VHDL](https://repo.masters-masters.com/languages/vhdl) |
| Licence | MIT |
| Création | 2015 |
| Sujets | uart, fpga, uart-controller, vhdl, controller, wishbone, wishbone-bus, uart-loopback, simulation, ghdl |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [jakubcabal/uart-for-fpga](https://github.com/jakubcabal/uart-for-fpga) |

## Fiche du dépôt

Simple UART controller for FPGA written in VHDL

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de jakubcabal

- [jakubcabal/spi-fpga · ★ 188 · VHDL · Prototype](https://repo.masters-masters.com/repos/jakubcabal/spi-fpga)

## D’autres dépôts VHDL

- [alberto-grl/1bitSDR · ★ 115 · VHDL · Prototype](https://repo.masters-masters.com/repos/alberto-grl/1bitSDR)
- [zzhuncle/TJCS-Undergraduate-Courses · ★ 112 · VHDL · Prototype](https://repo.masters-masters.com/repos/zzhuncle/TJCS-Undergraduate-Courses)
- [ckflight/FMCW3 · ★ 112 · VHDL · Prototype](https://repo.masters-masters.com/repos/ckflight/FMCW3)
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- [timvideos/HDMI2USB-jahanzeb-firmware · ★ 108 · VHDL · Prototype](https://repo.masters-masters.com/repos/timvideos/HDMI2USB-jahanzeb-firmware)
- [texane/vpcie · ★ 108 · VHDL · Prototype](https://repo.masters-masters.com/repos/texane/vpcie)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.