# jmahler/mips-cpu

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jmahler/mips-cpu, dépôt open source à 660 étoiles sur GitHub. Carte Alpha de RepoMasters. MIPS CPU implemented in Verilog Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [jmahler](https://repo.masters-masters.com/owners/jmahler) |
| Étoiles | 660 |
| Forks | 190 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | GPL-3.0 |
| Création | 2013 |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [jmahler/mips-cpu](https://github.com/jmahler/mips-cpu) |

## Fiche du dépôt

MIPS CPU implemented in Verilog

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## D’autres dépôts Verilog

- [antonblanchard/microwatt · ★ 729 · Verilog · Bêta](https://repo.masters-masters.com/repos/antonblanchard/microwatt)
- [OpenTimer/OpenTimer · ★ 722 · Verilog · Bêta](https://repo.masters-masters.com/repos/OpenTimer/OpenTimer)
- [ZipCPU/wb2axip · ★ 714 · Verilog · Bêta](https://repo.masters-masters.com/repos/ZipCPU/wb2axip)
- [fguzman82/gateGPT · ★ 656 · Verilog · Alpha](https://repo.masters-masters.com/repos/fguzman82/gateGPT)
- [ultraembedded/core\_ddr3\_controller · ★ 645 · Verilog · Alpha](https://repo.masters-masters.com/repos/ultraembedded/core_ddr3_controller)
- [dtysky/FPGA-Imaging-Library · ★ 644 · Verilog · Alpha](https://repo.masters-masters.com/repos/dtysky/FPGA-Imaging-Library)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.