# lsils/benchmarks

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lsils/benchmarks, dépôt open source à 273 étoiles sur GitHub. Carte Alpha de RepoMasters. EPFL logic synthesis benchmarks Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [lsils](https://repo.masters-masters.com/owners/lsils) |
| Étoiles | 273 |
| Forks | 52 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | MIT |
| Création | 2018 |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [lsils/benchmarks](https://github.com/lsils/benchmarks) |

## Fiche du dépôt

EPFL logic synthesis benchmarks

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de lsils

- [lsils/mockturtle · ★ 315 · C++ · Alpha](https://repo.masters-masters.com/repos/lsils/mockturtle)
- [lsils/lstools-showcase · ★ 213 · CSS · Prototype](https://repo.masters-masters.com/repos/lsils/lstools-showcase)

## D’autres dépôts Verilog

- [brianbennett/fpga\_nes · ★ 275 · Verilog · Alpha](https://repo.masters-masters.com/repos/brianbennett/fpga_nes)
- [Buck008/Transformer-Accelerator-Based-on-FPGA · ★ 275 · Verilog · Alpha](https://repo.masters-masters.com/repos/Buck008/Transformer-Accelerator-Based-on-FPGA)
- [funningboy/uvm\_axi · ★ 274 · Verilog · Alpha](https://repo.masters-masters.com/repos/funningboy/uvm_axi)
- [projf/display\_controller · ★ 271 · Verilog · Alpha](https://repo.masters-masters.com/repos/projf/display_controller)
- [geohot/twitchcore · ★ 267 · Verilog · Alpha](https://repo.masters-masters.com/repos/geohot/twitchcore)
- [lirui-shanghaitech/CNN-Accelerator-VLSI · ★ 267 · Verilog · Alpha](https://repo.masters-masters.com/repos/lirui-shanghaitech/CNN-Accelerator-VLSI)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.