# lucky-wfw/ARM\_AMBA\_Design

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lucky-wfw/ARM\_AMBA\_Design, dépôt open source à 150 étoiles sur GitHub. Carte Prototype de RepoMasters. Based on ARM AMBA bus protocol, Verilog is used to…

| Champ | Valeur |
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| Propriétaire | [lucky-wfw](https://repo.masters-masters.com/owners/lucky-wfw) |
| Étoiles | 150 |
| Forks | 38 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | GPL-3.0 |
| Création | 2020 |
| Sujets | verilog, amba, arm, apb, ahb, axi |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [lucky-wfw/ARM\_AMBA\_Design](https://github.com/lucky-wfw/ARM_AMBA_Design) |

## Fiche du dépôt

Based on ARM AMBA bus protocol, Verilog is used to design the digital circuit.

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## D’autres dépôts Verilog

- [freecores/verilog\_fixed\_point\_math\_library · ★ 151 · Verilog · Prototype](https://repo.masters-masters.com/repos/freecores/verilog_fixed_point_math_library)
- [chipsalliance/aib-phy-hardware · ★ 151 · Verilog · Prototype](https://repo.masters-masters.com/repos/chipsalliance/aib-phy-hardware)
- [SocialistDalao/UltraMIPS\_NSCSCC · ★ 151 · Verilog · Prototype](https://repo.masters-masters.com/repos/SocialistDalao/UltraMIPS_NSCSCC)
- [michaelehab/AES-Verilog · ★ 149 · Verilog · Prototype](https://repo.masters-masters.com/repos/michaelehab/AES-Verilog)
- [WangXuan95/FPGA-NFC · ★ 148 · Verilog · Prototype](https://repo.masters-masters.com/repos/WangXuan95/FPGA-NFC)
- [peilin-chen/Zhulong-RISCV-CPU · ★ 148 · Verilog · Prototype](https://repo.masters-masters.com/repos/peilin-chen/Zhulong-RISCV-CPU)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.