# open-sdr/openwifi-hw

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open-sdr/openwifi-hw, dépôt open source à 917 étoiles sur GitHub. Carte Bêta de RepoMasters. open-source IEEE 802.11 WiFi baseband FPGA (chip) design: FPGA…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [open-sdr](https://repo.masters-masters.com/owners/open-sdr) |
| Étoiles | 917 |
| Forks | 314 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | AGPL-3.0 |
| Création | 2019 |
| Sujets | fpga, ofdm, wi-fi, zynq, linux, mac80211, csma, dma, verilog, hls |
| Rang | [Bêta (700 à 1 999 ★)](https://repo.masters-masters.com/ranks/box_office) |
| Voir sur GitHub | [open-sdr/openwifi-hw](https://github.com/open-sdr/openwifi-hw) |

## Fiche du dépôt

open-source IEEE 802.11 WiFi baseband FPGA (chip) design: FPGA, hardware

Rang des dépôts qui ont 700 à 1 999 ★ sur GitHub. Probabilité publiée par carte tirée : 6 %. Rareté : Rare.

## Autres dépôts de open-sdr

- [open-sdr/openwifi · ★ 4 858 · C · RC](https://repo.masters-masters.com/repos/open-sdr/openwifi)

## D’autres dépôts Verilog

- [WangXuan95/FPGA-FOC · ★ 994 · Verilog · Bêta](https://repo.masters-masters.com/repos/WangXuan95/FPGA-FOC)
- [ultraembedded/cores · ★ 940 · Verilog · Bêta](https://repo.masters-masters.com/repos/ultraembedded/cores)
- [WangXuan95/FPGA-USB-Device · ★ 934 · Verilog · Bêta](https://repo.masters-masters.com/repos/WangXuan95/FPGA-USB-Device)
- [FeSens/openTPU · ★ 907 · Verilog · Bêta](https://repo.masters-masters.com/repos/FeSens/openTPU)
- [lvyufeng/step\_into\_mips · ★ 886 · Verilog · Bêta](https://repo.masters-masters.com/repos/lvyufeng/step_into_mips)
- [KastnerRG/riffa · ★ 884 · Verilog · Bêta](https://repo.masters-masters.com/repos/KastnerRG/riffa)

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Données : GitHub · Illustration : image publique du projet, pixelisée par RepoMasters.