# openrisc/or1200

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openrisc/or1200, dépôt open source à 184 étoiles sur GitHub. Carte Prototype de RepoMasters. OpenRISC 1200 implementation Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [openrisc](https://repo.masters-masters.com/owners/openrisc) |
| Étoiles | 184 |
| Forks | 78 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2014 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [openrisc/or1200](https://github.com/openrisc/or1200) |

## Fiche du dépôt

OpenRISC 1200 implementation

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de openrisc

- [openrisc/mor1kx · ★ 594 · Verilog · Alpha](https://repo.masters-masters.com/repos/openrisc/mor1kx)
- [openrisc/orpsoc-cores · ★ 125 · Verilog · Prototype](https://repo.masters-masters.com/repos/openrisc/orpsoc-cores)

## D’autres dépôts Verilog

- [thousrm/universal\_NPU-CNN\_accelerator · ★ 185 · Verilog · Prototype](https://repo.masters-masters.com/repos/thousrm/universal_NPU-CNN_accelerator)
- [pnnl/OpenCGRA · ★ 184 · Verilog · Prototype](https://repo.masters-masters.com/repos/pnnl/OpenCGRA)
- [ash-olakangal/RISC-V-Processor · ★ 184 · Verilog · Prototype](https://repo.masters-masters.com/repos/ash-olakangal/RISC-V-Processor)
- [zhanghai/archexp · ★ 182 · Verilog · Prototype](https://repo.masters-masters.com/repos/zhanghai/archexp)
- [sfmth/OpenSpike · ★ 182 · Verilog · Prototype](https://repo.masters-masters.com/repos/sfmth/OpenSpike)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.