# secworks/aes

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secworks/aes, dépôt open source à 471 étoiles sur GitHub. Carte Alpha de RepoMasters. Verilog implementation of the symmetric block cipher AES (Advanced…

| Champ | Valeur |
| --- | --- |
| Propriétaire | [secworks](https://repo.masters-masters.com/owners/secworks) |
| Étoiles | 471 |
| Forks | 151 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | BSD-2-Clause |
| Création | 2014 |
| Sujets | aes, encryption, asic, fpga, block-cipher |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [secworks/aes](https://github.com/secworks/aes) |

## Fiche du dépôt

Verilog implementation of the symmetric block cipher AES (Advanced Encryption Standard) as specified in NIST FIPS 197. This implementation supports 128 and 256 bit keys.

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de secworks

- [secworks/sha256 · ★ 394 · Verilog · Alpha](https://repo.masters-masters.com/repos/secworks/sha256)

## D’autres dépôts Verilog

- [AngeloJacobo/UberDDR3 · ★ 497 · Verilog · Alpha](https://repo.masters-masters.com/repos/AngeloJacobo/UberDDR3)
- [hunterlew/convolution\_network\_on\_FPGA · ★ 488 · Verilog · Alpha](https://repo.masters-masters.com/repos/hunterlew/convolution_network_on_FPGA)
- [jhshi/openofdm · ★ 484 · Verilog · Alpha](https://repo.masters-masters.com/repos/jhshi/openofdm)
- [T-K-233/RISC-V-Single-Cycle-CPU · ★ 466 · Verilog · Alpha](https://repo.masters-masters.com/repos/T-K-233/RISC-V-Single-Cycle-CPU)
- [wuxx/icesugar · ★ 463 · Verilog · Alpha](https://repo.masters-masters.com/repos/wuxx/icesugar)
- [nand2mario/nestang · ★ 459 · Verilog · Alpha](https://repo.masters-masters.com/repos/nand2mario/nestang)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.