# suisuisi/FPGAandCNN

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suisuisi/FPGAandCNN, dépôt open source à 375 étoiles sur GitHub. Carte Alpha de RepoMasters. 基于FPGA的数字识别-实时视频处理的定点卷积神经网络实现 Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [suisuisi](https://repo.masters-masters.com/owners/suisuisi) |
| Étoiles | 375 |
| Forks | 77 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2021 |
| Rang | [Alpha (250 à 699 ★)](https://repo.masters-masters.com/ranks/b_movie) |
| Voir sur GitHub | [suisuisi/FPGAandCNN](https://github.com/suisuisi/FPGAandCNN) |

## Fiche du dépôt

基于FPGA的数字识别-实时视频处理的定点卷积神经网络实现

Rang des dépôts qui ont 250 à 699 ★ sur GitHub. Probabilité publiée par carte tirée : 20 %. Rareté : Peu commune.

## Autres dépôts de suisuisi

- [suisuisi/FPGA\_Library · ★ 234 · VHDL · Prototype](https://repo.masters-masters.com/repos/suisuisi/FPGA_Library)
- [suisuisi/FPGA · ★ 132 · VHDL · Prototype](https://repo.masters-masters.com/repos/suisuisi/FPGA)
- [suisuisi/FPGAandImage · ★ 122 · VHDL · Prototype](https://repo.masters-masters.com/repos/suisuisi/FPGAandImage)

## D’autres dépôts Verilog

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- [viduraakalanka/HDL-Bits-Solutions · ★ 379 · Verilog · Alpha](https://repo.masters-masters.com/repos/viduraakalanka/HDL-Bits-Solutions)
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- [wuxx/Colorlight-FPGA-Projects · ★ 372 · Verilog · Alpha](https://repo.masters-masters.com/repos/wuxx/Colorlight-FPGA-Projects)
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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.
