# ttchisholm/10g-low-latency-ethernet

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ttchisholm/10g-low-latency-ethernet, dépôt open source à 111 étoiles sur GitHub. Carte Prototype de RepoMasters. 10G Low Latency Ethernet

| Champ | Valeur |
| --- | --- |
| Propriétaire | [ttchisholm](https://repo.masters-masters.com/owners/ttchisholm) |
| Étoiles | 111 |
| Forks | 34 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | MIT |
| Création | 2022 |
| Sujets | cocotb, ethernet, fpga, pyuvm, systemverilog, xilinx |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [ttchisholm/10g-low-latency-ethernet](https://github.com/ttchisholm/10g-low-latency-ethernet) |

## Fiche du dépôt

10G Low Latency Ethernet

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.