# z4yx/NaiveMIPS-HDL

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z4yx/NaiveMIPS-HDL, dépôt open source à 117 étoiles sur GitHub. Carte Prototype de RepoMasters. Naïve MIPS32 SoC implementation Langage : Verilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [z4yx](https://repo.masters-masters.com/owners/z4yx) |
| Étoiles | 117 |
| Forks | 35 |
| Langage | [Verilog](https://repo.masters-masters.com/languages/verilog) |
| Licence | Aucune |
| Création | 2017 |
| Sujets | mips, cpu, verilog |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [z4yx/NaiveMIPS-HDL](https://github.com/z4yx/NaiveMIPS-HDL) |

## Fiche du dépôt

Naïve MIPS32 SoC implementation

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de z4yx

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## D’autres dépôts Verilog

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- [brabect1/sta\_basics\_course · ★ 116 · Verilog · Prototype](https://repo.masters-masters.com/repos/brabect1/sta_basics_course)
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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.