# zeroasiccorp/umi

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zeroasiccorp/umi, dépôt open source à 172 étoiles sur GitHub. Carte Prototype de RepoMasters. Universal Memory Interface (UMI) Langage : SystemVerilog.

| Champ | Valeur |
| --- | --- |
| Propriétaire | [zeroasiccorp](https://repo.masters-masters.com/owners/zeroasiccorp) |
| Étoiles | 172 |
| Forks | 21 |
| Langage | [SystemVerilog](https://repo.masters-masters.com/languages/systemverilog) |
| Licence | Apache-2.0 |
| Création | 2022 |
| Rang | [Prototype (100 à 249 ★)](https://repo.masters-masters.com/ranks/rush) |
| Voir sur GitHub | [zeroasiccorp/umi](https://github.com/zeroasiccorp/umi) |

## Fiche du dépôt

Universal Memory Interface (UMI)

Rang des dépôts qui ont 100 à 249 ★ sur GitHub. Probabilité publiée par carte tirée : 70 %. Rareté : Commune.

## Autres dépôts de zeroasiccorp

- [zeroasiccorp/switchboard · ★ 325 · Python · Alpha](https://repo.masters-masters.com/repos/zeroasiccorp/switchboard)
- [zeroasiccorp/wildebeest · ★ 146 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/zeroasiccorp/wildebeest)

## D’autres dépôts SystemVerilog

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- [ijor/fx68k · ★ 174 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/ijor/fx68k)
- [mbits-mirafra/SystemVerilogCourse · ★ 172 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/mbits-mirafra/SystemVerilogCourse)
- [mayurkubavat/UVM-Examples · ★ 169 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/mayurkubavat/UVM-Examples)
- [riscv-verification/RVVI · ★ 168 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/riscv-verification/RVVI)
- [bsc-loca/sargantana · ★ 168 · SystemVerilog · Prototype](https://repo.masters-masters.com/repos/bsc-loca/sargantana)

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Données : GitHub · Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage.