Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage. Crédits
PrototypeCommune

StefanSredojevic/Deep-Neural-Network-Hardware-Accelerator

SystemVerilog HDL and TB code Deep Neural Network Hardware Accelerator implementation on zybo 7010 FPGA and also C code for Vivado SDK Software

Propriétaire
StefanSredojevic (compte personnel)
Étoiles
Étoiles : 117
Forks
Forks : 46
Langage
SystemVerilog
Licence
Aucune
Création
2018
Rang
Prototype (100 à 249 ★) Ce que veut dire ce rang
Voir sur GitHub

D’autres dépôts SystemVerilog

Tous les dépôts SystemVerilog