Illustration dessinée par RepoMasters à partir de l’identifiant du dépôt et de la couleur de son langage. Crédits
PrototypeCommune

GuoningHuang/FPGA-CNN-accelerator-based-on-systolic-array

2023集创赛国二。基于脉动阵列写的一个简单的卷积层加速器,支持yolov3-tiny的第一层卷积层计算,可根据FPGA端DSP资源灵活调整脉动阵列的结构以实现不同的计算效率。

Propriétaire
GuoningHuang (compte personnel)
Étoiles
Étoiles : 249
Forks
Forks : 14
Langage
Verilog
Licence
GPL-3.0
Création
2023
Rang
Prototype (100 à 249 ★) Ce que veut dire ce rang
Voir sur GitHub

D’autres dépôts Verilog

Tous les dépôts Verilog